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MC100LVEL51DR2G Fiches technique(PDF) 2 Page - ON Semiconductor |
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MC100LVEL51DR2G Fiches technique(HTML) 2 Page - ON Semiconductor |
2 / 9 page MC100LVEL51 www.onsemi.com 2 1 2 3 45 6 7 8 Q VEE VCC D Q CLK CLK R D R Flip-Flop D L H X R L L H CLK Z Z X Q L H L Z = LOW to HIGH Transition X = Don’t Care CLK, CLK ECL Differential Clock Input Q, Q ECL Differential Output D ECL D Input R ECL Reset Input VCC Positive Supp;y VEE Negative Supply Table 1. PIN DESCRIPTION PIN FUNCTION Table 2. TRUTH TABLE Figure 1. Logic Diagram and Pinout Assignment EP (DFN8 only) Thermal exposed pad must be connected to a sufficient thermal conduit. Elec- trically connect to the most negative supply (GND) or leave unconnected, floating open. |
Numéro de pièce similaire - MC100LVEL51DR2G |
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