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TPS61282YFF Fiches technique(PDF) 8 Page - Texas Instruments |
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TPS61282YFF Fiches technique(HTML) 8 Page - Texas Instruments |
8 / 58 page Sr P Sr tfDA trDA thd;DAT tsu;STA thd;STA tsu;DAT tsu;STO trCL1 tfCL tHIGH tLOW tLOW tHIGH trCL trCL1 = MCS Current Source Pull-Up = R(P) Resistor Pull-Up SDAH SCLH Note A: First rising edge of the SCLH signal after Sr and after each acknowledge bit. See Note A See Note A tf tLOW tr thd;STA thd;DAT tsu;DAT tf HIGH tsu;STA S Sr P S thd;STA tr tBUF tsu;STO SDA SCL TPS61280 , TPS61281, TPS61282 SLVSBI1 – OCTOBER 2013 www.ti.com I 2C TIMING DIAGRAMS Figure 1. Serial Interface Timing Diagram for Standard-, Fast-, Fast-Mode Plus Figure 2. Serial Interface Timing Diagram for H/S-Mode 8 Submit Documentation Feedback Copyright © 2013, Texas Instruments Incorporated Product Folder Links: TPS61280 TPS61281 TPS61282 |
Numéro de pièce similaire - TPS61282YFF |
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Description similaire - TPS61282YFF |
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