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74LVC2G125GD Fiches technique(PDF) 3 Page - NXP Semiconductors |
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3 / 17 page 74LVC2G125_10 © NXP B.V. 2008. All rights reserved. Product data sheet Rev. 10 — 11 June 2008 3 of 17 NXP Semiconductors 74LVC2G125 Dual bus buffer/line driver; 3-state 6. Pinning information 6.1 Pinning 6.2 Pin description Fig 3. Pin configuration SOT505-2 (TSSOP8) and SOT765-1 (VSSOP8) Fig 4. Pin configuration SOT833-1 (XSON8) 1OE VCC 1A 2OE 2Y 1Y GND 2A 001aab738 1 2 3 4 6 5 8 7 74LVC2G125 74LVC2G125 1Y 2OE VCC 2A 2Y 1A 1OE GND 001aab739 36 27 18 45 Transparent top view Fig 5. Pin configuration XSON8 Fig 6. Pin configuration XQFN8U 001aai243 74LVC2G125 Transparent top view 8 7 6 5 1 2 3 4 1OE 1A 2Y GND VCC 2OE 1Y 2A 001aae010 1A 1Y 1OE 2Y 2OE 2A Transparent top view 3 6 1 5 7 2 terminal 1 index area 74LVC2G125 Table 3. Pin description Symbol Pin Description SOT505-2, SOT765-1, SOT833-1 and SOT996-2 SOT902-1 1OE, 2OE 1, 7 7, 1 output enable input (active LOW) 1A, 2A 2, 5 6, 3 data input GND 4 4 ground (0 V) 1Y, 2Y 6, 3 2, 5 data output VCC 8 8 supply voltage |
Numéro de pièce similaire - 74LVC2G125GD |
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Description similaire - 74LVC2G125GD |
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