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SN74GTLP1395DWE4 Fiches technique(PDF) 4 Page - Texas Instruments |
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SN74GTLP1395DWE4 Fiches technique(HTML) 4 Page - Texas Instruments |
4 / 21 page SN74GTLP1395 TWO 1-BIT LVTTL-TO-GTLP ADJUSTABLE-EDGE-RATE BUS TRANSCEIVERS WITH SPLIT LVTTL PORT, FEEDBACK PATH, AND SELECTABLE POLARITY SCES349C – JUNE 2001 – REVISED NOVEMBER 2001 4 POST OFFICE BOX 655303 • DALLAS, TEXAS 75265 logic diagram (positive logic) 1OEAB 1T/C 1OEBY 5 2 20 ERC 15 1A 7 1Y 1 VREF 12 2A 9 2Y 3 1B 16 2B 14 2OEBY 18 2T/C 19 2OEAB 10 Pin numbers shown are for the DGV, DW, and PW packages. |
Numéro de pièce similaire - SN74GTLP1395DWE4 |
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Description similaire - SN74GTLP1395DWE4 |
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